【IPC-7095C】_BGA设计与组装工艺的实施_(IPC标准).pdf - 第33页

剂 , 芯片 与 基板 的间 隙 需 要 用 环氧 树脂 进 行底 部 填充 以确 保芯片 与 基板界 面的 机械完整性 。 采用 各 向 异 性导 电材料 排 除 了 增加底 部 填充 的 需 求。在 基板 与 芯片相 连接 之 后 , 芯片 通 常 会 以 灌 封 、 涂覆或模封 的方 式 进 行保护 。 4.3 标准 化 BGA 封 装的标准化 涉 及 到一 系 列 的 物 理变 量,包 括每 个 焊 球的 直 径 、 焊 球在 …

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电气连接。基板上的导线
导线键合焊盘传递 基板底部的BGA
球。引线键合工艺,芯片键合区域
采用密封保护用封装材料部包封或
行模压装的种替代方组装
接一个的上
BOC或芯片正结构中,芯片上的键合
焊盘布置于芯片成一
式布置于芯片中心。基板设计成一个窄槽以容
芯片或多
键合焊盘用于芯片
基板上的粘合剂涂键合焊盘左侧
粘合剂或膜形式施加
的主表面电路面,面下连接到
基板带键合焊盘沟槽
4-2所示。
芯片连接和粘合剂化,芯片上的键合
焊盘基板绕沟槽焊盘金属线键合
式相连。在金属线键合导线
表面装所保护
意的此时
去除行或阵列以容用于基板
键合沟槽同时也需意的金属线键
芯片成的,芯片并不
围区域用于芯片基板的连接。图4-3
示了模封BGA装的部和部。
4.2.2 倒装芯⽚ 芯片或芯片连)
金属线芯片连接的要。在计中,
预凸型芯片的电路面倒置下,此面上的连接
过焊粘合剂基板上的连接
连。然而芯片键合焊盘并不会
粘合剂连接工艺兼容。在芯片圆被
之前兼容合金
的工艺一。要接材料及焊盘结
材料来化电气和机械连接,4-4
示。
粘合剂或连接采用然而,
芯片凸触金属合金便粘合
中的合金颗粒兼容这种合金点或
球可或焊键合工艺施加于芯片
键合焊盘如果使用焊性导粘合
IPC-7095c-4-2-cn
图4-2 BOC BGA 结构
密封材料
聚酰亚胺薄
阻焊层
金属线键合
粘合剂
IPC-7095c-4-3-cn
图4-3 BOC类BGA模封顶部
IPC-7095c-4-4-cn
图4-4 BGA基板上的倒装芯⽚(带凸点的芯⽚)
散热片
导热膏
芯片焊
基板
BGA
线
填充
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芯片基板的间环氧树脂行底
填充以确保芯片基板界面的机械完整性
采用性导电材料增加底填充
求。在基板芯片相连接芯片
涂覆或模封的方行保护
4.3 标准 BGA装的标准化到一
理变量,包括每球的球在
器件外形内
4.3.1 BGA⾏业标准
多封化的
,包机械尺寸,可
JEDEC开发的BGA南。
4.3.1.1 BGA封装 JEDEC 出版JEP95,章
4.14定义了球栅阵列和栅阵列列。球栅
阵列(BGA栅阵列(CGA
1.501.271.00mm分布金属
形或形封装,装的本有一
金属化电路图绝缘结构。对
于封
半导体芯片在上面下面。在绝缘
结构底金属化球/柱阵列图
印制板机械或
电气连接。含有芯片一面可技术
密封保护半导体
4.3.1.2 节距球栅阵列封装 JEDEC出版
JEP95,章4.5定义:密节距球栅阵
FBGA节距小于1.00mm)版本
的球栅阵列装。载体施加绝缘结构
金属化电路图。一个
或多半导体器件
绝缘结构或底面。在绝缘结构的下
金属球图装本印制
机械或电气连接。含有芯片一面
技术行封保护半导体材料。
FBGA列的标准的连接
节距:0.500.650.80mm,同时规定了四
器件外形高度化。增加0.75mm
节距纳入芯片级尺寸BGADSBGA
南,此对于芯片级尺寸器件系
了四节距
元器件底座至顶部测得的FBGA外形高度
1.70mm形密节距球栅阵列LFBGA
FBGA外形高度降低版本。元器件底
部测得LFBGA外形高度不大
1.2mm外形密节距球栅阵列(TFBGA
FBGA外形高度降低的版本,元器件底座
部测得的外形高度不会1.00mm
外形密节距球栅阵列(VFBGAFBGA
外形高度降低的版本,元器件底座
部测得的外形高度小于
0.80mm
中心间距或节距增加时,JEDEC
FBGA 南中 制造 增加焊
4-1所示)JEDECFBGA
FRBGA 不支持0.75mm节距
而,业已注了一0.75mm节距不一
器件这些并不JEDEC装。
使用较大的尺寸以适介基板
装。球可
弥补
芯片性印制电路板结构膨胀系数
CTE匹配
4.3.1.3 节距 BGA封装 JEDEC出版
JEP95,第4.6定义了在部有金属球阵列
密节距球栅阵列(FRBGA载体或
基板绝缘结构单面施加形金属
电路图JEP95,第4.5章的通用说法来表
述,FRBGA体尺寸用D尺寸E尺寸定义
D尺寸平行于封装主所量出的尺寸,而E
平行于次轴所量出的尺寸此,对
形封装,D尺寸E尺寸大。
4.3.1.4 芯⽚尺⼨BGA封装 JEDEC出版JEP
95,第4.7章中定义芯片级尺寸栅阵列
DSBGA芯片尺寸球栅阵列在部有
球阵列。装的基板或载体绝缘结构
单面施加有方形或形金属化电路图
半导体芯片绝缘结构的上表面连接。
绝缘结构部,金属球阵列图
装本连接到下一级元件
印制电路
4-1 JEDEC标准JEP95-1/5
容许直径变化FBGA
球节距
直径/mm
最⼩ 称最
0.50 0.25 0.30 0.35
0.65 0.25 0.30 0.35
0.65 0.35 0.40 0.45
0.80 0.25 0.30 0.35
0.80 0.35 0.40 0.45
0.80 0.45 0.50 0.55
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机械和电气连接。含芯片一面可用多装技
术对半导体行保护基板或载体尺寸
能接芯片尺寸
芯片尺寸球栅阵列DSBGA
尺寸与特定芯片尺寸可能接 的球栅阵列
装。这种也被称正芯片级尺
Real chip-size)球栅阵列CSP装本
尺寸仅可小芯片的组装,这些
尺寸随着后芯片小变化时而化。
装的外形以是形或;当
为了新的芯片尺寸计时,
宽比会发化。不同
器件可能有不同的宽比DSBGA
标准化的球阵列的大宽比
D尺寸E尺寸定义DSBGA装的本
于带形焊球阵列的装,阵列决定
的方D尺寸平行于焊球阵列主测得的
尺寸,而E尺寸平行于焊球阵列次轴测得的
此对
形封装,JEDEC JEP
954.6FRBGA要求的D尺寸E
尺寸有方形焊球阵列的DSBGA
D尺寸E尺寸JEDECD
E尺寸JEDEC出版95定义
0.5mm作为递增量,值是DSBGA
的实尺寸下一个0.50mm整数
得。
照这规定D尺寸E尺寸形式
y.00y.50
DSBGA装的阵列节距要与DE阵列
寸相同。节距同的下,装的
尺寸和公差由较小节距尺寸和公来主
DSBGA球阵列的制节距总是小于
1.0mmJEP95,章4.7中所述的DSBGA
点节距0.800.750.650.50mm
4.3.2 球节距 BGA节距主要可
组。
第一组包料和陶瓷封外形点节距
1.501.271.00mm组为密节距或芯片
BGA列,节距焊点节距0.800.75
0.650.500.400.30 mm,对于芯片尺寸BGA
节距0.25mm球栅阵列
方面的力,很少
制造商还在提节距1.5mm器件。同时,
节距0.4mm球,但由
传统的表面贴组装可能会到限
节距在各径选到了
。表4-2示了节距0.5-1.5mm球栅
阵列的球特征;4-3示了DSBGA
球可能的
球图在组装程中
向自动化检测方面有优势
型例子为在本对的阵列中去除
中一个位角落球。
4.3.2.1 未来触点尺⼨ 4-2
BGA这些尺寸来可中的
4-3所示。
4.3.2.2 连接盘图形的近似算 元器件基板
(连接有球)的连接和贴装结构
制板)的连接径应该越
元器件制造厂商印制板连接盘或元器件
焊盘应略小于焊。连接盘尺寸减少
决于原始尺寸这常连接
尺寸。在值之间关时,
连接盘尺寸制造量,
0.40mm时,大实MMC)与
LMC之差0.1mm
径小于0.40mm时,该余应相应
4-4了关连接数据及9
化。
多元器件制造使用阻焊膜连接
6.2.2。在 运用项技术时,连接的标
阻焊膜在连接上的侵入(通
4-2 PBGA器件的直径
称焊
直径(mm)公范围(mm) 节距(mm
0.75 0.90 0.65 1.5, 1.27
0.60 0.70 0.50 1.0
0.50 0.55 0.45 1.0, 0.80
0.45 0.50 0.40 1.0, 0.80, 0.75
0.40 0.45 0.35 0.80, 0.75, 0.65
0.30 0.35 0.25 0.80, 0.75, 0.65, 0.50
4-3 DSPBGA未来焊直径
直径
称值mm
公差变化
范围(mm 节距(mm
0.25 0.28 0.22 0.40
0.20 0.22 0.18 0.30
0.15 0.17 0.13 0.25
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