IPC-7093 CN 2011 底部端子元器件(BTC)设计和组装工艺的实施.pdf - 第20页

部的可 见 证 据 , 即 使 这 金属 端的 切口是 不 润湿 的。 从 封装 顶 部 检查 BTC 元器件的焊 点是 困难 的。 所 以即 使 没 有 预 期 趾 部 或 末 端 填充 , 也 有 必 要 将 PCB 倾斜 来 检查 BTC 焊 点 , 观察 封装下面的焊 料。 更 多详细 的 BTC 元器件组装 后检查 技术, 请见 7.4 。 X-ray 检查是检 测 BTC 封装底部 短 路的一 种方 法 。 X-ray 图 …

100%1 / 124
要求大的电源/焊盘和的信焊盘,
这就要对信焊盘加模板开
路,与此同时,对电源/焊盘要大大小模
板开防挤焊料路。
3-8示了焊接盘图形设计的南。焊盘要
引线大。焊盘图形应该超出封装引线
封装底部的引线板开孔尺寸必须
要与焊盘图形的尺寸间隙时,要
使用阻以将焊料在焊盘图形内,3-
8所示。
BTC封装来板开
设计不仅对于预
开路和的,对于预BTC封装漂浮
常见现象也要的。
实际情况是BTC封装与其它类型的表面贴装元
器件一使用,包BGAPQFP必须
板子上小间距的元器件来选择焊料粉末
尺寸具体的封装可能可能不BTC
封装。BTC的焊膏厚度一个关,焊
太少或很可能成焊开路,但是
过量的焊元器件的漂浮。为了防止
焊接过程中元器件的漂浮,焊
沉积厚度(特
间散热焊盘上的焊膏厚度)应该不能过
3-9板的设计方法,可达到散热焊盘面
5060覆盖
议模板的设计能提散热焊盘5060
膏覆盖 及对输入/ 出焊盘100膏覆
。图3-10示了这样板设计,使得焊
地平面不要覆盖,而焊外围输入/
出焊盘达到100%覆盖
焊盘图形设计应该允许封装引线超出封装
以便
AOI视检查。要住重要一
点是端子填充是要求的,封装
方式是切割成型的,有外露而未镀处
理切口,不可能形成定一填充。焊
盘图形伸应该一个再流后焊料在BTC
3-1 BTC元器件的总经营成本
成本来源 影响
来料检验
来料检验信心关,信心考虑可能到的缺陷解决的成本。一个
的过程,但产品退回毁掉意。
元器件封装设计
为了成本和可靠性目标,要的经验法选择和设计最低成本的封装。在设计限制内,
引线数量要求和在可容间距下的要求。在某些情下,出于改进产品成本和可靠性,可能
需要考虑改产品
点是产品靠性。焊料的和成形对BTC组装的良率和可靠性是的。芯片连接盘
(DAP)一直被一个很重要的要为有果没有焊接到位会靠性
PCB板设计 料的选择布局和焊盘图形设计要的,可影响PCB的成本、组装良率和可靠性
组装方法
组装工艺有步骤,包、元器件贴装、再流焊接和。在工艺过程得到很好制的下,
成本
总成本分比则将占据大成本。在某些情下,使用BTC封装元器件需要
工艺设了一成本,改进产品良率总成本。
测试&检测
不可能检查产品的内部量时,测试检验常被保证制程制。这样某些级别检查X-RAY
测试验证组装量。组装有可焊BTC元器件经表需要提升改进再流后检测能力。
BTC元器件
步骤不能确保可焊的。要求供应商生有可焊BTC可能要
或临点流再流检查会导致终客户降信任而升总成本。
靠性
的设计保证靠性成本。设计的可靠性是一个的过程,表主要的
成本。然而失效,特别现场失效会对成本生更大的影响
3-8 BTC阻焊膜间隙参考
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IPC-7093-3-9-cn
3-9 散热焊盘上模板分区图形设计图例
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20113 IPC-7093-C
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部的可使金属端的切口是润湿
的。
封装检查BTC元器件的焊点是困难的。
以即使填充
PCB倾斜检查BTC观察封装下面的焊
料。多详细BTC元器件组装后检查技术,
请见7.4
X-ray检查是检BTC封装底部路的一种方
X-ray 观察点空洞的一个
BTC元器件焊空洞分比
BGA
空洞25%小BTC
器件有焊空洞的可能大大BGA
元器件。但是BTC元器件散热焊盘焊空洞
限要大得散热焊盘上有的焊
量。建/根据各自要求在
洞体分布允许极限。
切片芯片渗透技术是检测其它方法
这些方法用于产检验,而应该用于
艺的开发。
PCB工中
下的BTC元器件不应该再用于
的组装中。一个经焊接到PCB板的封装
拆除经过再流焊接,PCB是双
面板,封装经过三再流焊接。
下封装处于近已寿命能力范围(经过
定的)的限。这些下的BTC元器件
置,不能和其它BTC元器件混
合。多详细BTC元器件的工和修理请见
7.7
BTC应该多其它类型的
,要
的工拆除替换缺陷的元
器件。如热风光系统这样的工具用于
工来拆除BTC件,在加热
清理焊盘和量焊对元器件
位。
3.6 未来的需求和期望 成本,BTC
但是考虑了封装、组
装、检验维修和可能场失效几方
的总成本封装成本不一定总成本。
失效因是
出的引线
从积极的一面出的引线是BTC
增强散热性能和电气能的
关注成本,封装供应商已
封装成本的环境
PCB 和制成本的事
4 元器件考虑
节依元器件制了各BTC
,描述了同时使用引线框基材常见
造方法和来自各制程的常见缺陷。本节也
描述了不同封装的产流及形料和
标准变化
然在小外封装技术有一
新存在(例如:BGAFBGA),直没有一个
效方法著降封装面和成本,
SOQF封装技术。这些小外引线框
封装列的最显的特点是它们的
电气寄生外露引线框以将芯片产
量有效传到与连的电路板散热
盘上,
而提高其散热能力。于小外形和
引线,电气寄生当
4.1 不同BTC封装类型的总体说明 市场
大量不同封装类型的BTC,可根据
面来选择:
1) 封装结构
2) 间距(1.0-0.4mm)
3) 端子形状尺寸
4) 连接盘图形形状尺寸
3-10 建议模板设计:接地焊的焊膏覆盖率在50%-
60%(但是I/O焊盘要100%)
IPC-7093-C 20113
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5)封厚度
6) 散热焊盘形状尺寸
7)电
4-1表示由供应商到电路板组装的一
BTC元件。
这些元器件有多配置可选择。表4-1展示了
封装代工可提QFSO(DF)
置。其它代工多相产品有在
列出来的一产品JEDEC标准通用方
列出了多其它尺寸引线厚度组合,
并不
栅阵列(LGA)JEDEC标准和上表中的类
尺寸LGA
5mm×5mm
装在多层基材上。多基于基材LGA
器件包含有多芯片无源器件。这些
可能 个不同的但互 模块
成,们在一构成类为SiP(统级封装)
产品4-2
4.2 BTC的详细说明和标准
4.2.1 单排模封引线框封装 芯片连接盘(DAP)
外露物外面时,散热器的
IPC-7093-4-1-cn
4-1 各种形状的BTC元器件
4-1 QFDF配置
市场典型塑料封装QF/SO(DF)
所有尺⼨以毫⽶
⼤⼩ QF DF 引线间 厚度
2×268 0.50 0.9
3×3 8 0.65 0.9
3×31216 810 0.50 0.9
3×3 20 0.40 0.9
4×3 12 0.50 0.9
4×4 16 0.65 0.9
4×42024 0.50 0.9
5×5 20 0.65 0.9
5×52832 0.50 0.9
6×6 40 0.50 0.9
7×7 48 0.50 0.9
7×7 56 0.40 0.9
8×85256 0.50 0.9
9×9 64 0.50 0.9
12×12 100 0.40 0.9
IPC-7093-4-2-cn
4-2 单个LGA元器件底部
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