Cadence_16.6高速电路板设计与仿真.pdf - 第323页

( 1 ) “ A l g o r i t h m ( 布局 算 法) ” 选项 组 ● “ D i s c r e a t e ” : 离散 元 件。 ● “ I C ” : 集成 电 路。 ● “ A r r a y ” : 阵列 。 ( 2 ) “ D i r e c t i o n ( 布 局 方向 ) ” 选 项组 ● “ N o r t h ” :与 P C B 边框 线 顶部 的 极限 间 距。 ● “ E a s t ”…

100%1 / 401
4 PlacementOrigin布局点)选项
Pin1:以 1为布局点。
BodyCenter以元中心布局点。
SymbolOrigin以元符号布局点。
5 Nets网络 项组
Power在该本框可以写一称。
脚元件通被称退耦容,统将自动置到之相的元
电源络可加速动布的进
Ground:在文本中可填写个或个地线网络名称跨过些网的双
脚元件通被称退耦容,统将自动置到之相的元
地线络同可以速自布局进程
ArrayedComponents选此选框按照列布元件装。
3.设置动布
选择单栏 Place置)
Autoplace
Parameters
设置 令, AutomaticPlacement自动局)对话,如 1125所示下面
绍各项的义。
1125 AutomaticPlacement动布 对话
113
1 Algorithm 布局法)选项
Discreate离散件。
IC集成路。
Array阵列
2 Direction方向 项组
North:与 PCB边框线顶部极限距。
East PCB线右的极间距
South PCB线底的极间距
West:与 PCB线左的极间距
3Rotation旋转度) 项组在进元件
件组行旋,默有四选项 0901802700 50
布局件角
0°多个 50余选均默 0
Straight入相连接元件默认 75
Mirror定布的元所在
Leftovers:勾此复框,理未放的件。
Overlap勾选复选,布过程元件以重
Softboundary勾选复选,元可以置在路板外的间。
Clockredistribution选此选框元件局过中可新分
Cluster勾选复选,将动放的元进行组。
Norat:勾此复框,动放元件不显飞线
RemoveTAG:勾此复框,性在成自放置删除
如无殊要求, 钮,作,
在完自动局后信息板中示信,提自动局结
元件自动局后再是照种排列起。择,
初步成若组分
PCB中。
因此需要自动局进调整
11.5 3D
元件布局毕后PCB 1126。可通过 3D图,果,
查布是否理。
PCB View
3D Viewer3D
令,系统成该 PCB 3D图。 Allegro3DViewer3D
如图 1127所示
在该口中进行项操,如出图、设显示式等
1.图片
选择单栏 Files文件
ExportImage图片 令,
的形式输 PCB果图输入片名 CLOCK 1128
保存片文
213
1126 局后 PCB
1127 PCB 3D果图
2.显示
选择单栏 Mode模式
令, 1129 3
示模
313